O depósito de patente da Hitachi, Ltd. descreve um array de qubit com fileiras de pontos quânticos móveis e fixas organizadas em uma topologia de duplo anel para implementar correção de erros quânticos, enquanto otimiza o espaço de controle para fiação.

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IonQ demonstrou que CPUs padrão podem lidar com decodificação de erros em tempo real para 408 qubits lógicos e 31+ milhões de operações, sugerindo que a correção de erros não será um gargalo primário de escalabilidade quântica.

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