来自量子平台各领域的世界专家一致认为，错误纠正是阻碍容错系统的重大挑战。谷歌的超导量子比特实验显示错误率呈指数级下降，表明在实用量子计算方面取得了真正的进展。

#量子错误纠正 #容错 #新闻

Quantinuum 在 Helios 系统上实验性地验证了 Helix 量子纠错架构，演示了逻辑内存、计算和纠缠，无需后选择。创纪录的保真度进展推动了可扩展容错量子计算的发展。

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新算法实现了高达故障距离7的含噪声逻辑魔法态准备协议的精确多项式时间模拟——这是在无需指数级缩放情况下对容错量子计算进行基准测试的突破。

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新型的'边测边聚类'解码器在测量过程中处理症状数据，减少了测量后的空闲时间。为表面码实现了更好的速度-准确性权衡，这对扩展容错量子计算走向实用系统至关重要。

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QC Design 与 NVIDIA 合作，使量子硬件团队能够准确模拟容错量子计算架构，包括晶格手术和逻辑协议，采用逼真的物理模型。

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研究人员开发了一种并行化的最小权完美匹配解码器，每个综合征提取回合实现拟多项式对数运行时间，使得量子纠错速度渐近快于综合征提取时间尺度本身。

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NVIDIA 发布了 CUDA-Q Logical，这是一个统一的编译框架，用于容错量子计算，可共同设计高级算法、纠错码和硬件架构。早期部署在系统建模中实现了 7 倍的加速，并展示了集成...

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IQM将NVIDIA CUDA-Q Logical集成到其150量子比特Halocene量子纠错系统中，支持跨异构后端对容错量子纠错算法进行标准化基准测试，并具有实时GPU解码协处理功能。

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新型协议在魔幻态制备中实现了立方误差抑制，通过优化的稳定子-生成器设计，将资源开销减少到19个量子比特和82个CNOT门，用于容错量子计算。

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引入了扩展检测器错误模型（EDEMs），可以对容错量子电路进行模块化组合。单个器件的错误模型可以按顺序和并行方式组合，无需重新分析物理电路，支持自适应计算和流式解码。

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NVIDIA 推出 CUDA-Q Logical 编排层，支持可编程开发容错量子应用，推进实用量子计算能力。

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NVIDIA 的 CUDA-Q Logical 为容错量子计算提供了开放、可扩展的层，能够在不同的QEC码和架构之间进行可复现的工作负载比较——这是朝向实用量子计算迈出的关键一步。

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研究人员证明，容错量子计算的物理开销取决于调度和空间组织，而不仅仅是逻辑资源。非Clifford实现选择可将时空体积减少241.5倍（在基准测试中）。

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研究人员开发了新的代数工具，用于使用分圆集设计CSS-T量子纠错码，使得能够构造具有改进纠错能力的更长码，这对容错量子计算至关重要。

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研究人员使用匹配门和非高斯门为容错费米子量子计算确立了约62%的噪声容限，超过了Clifford+T系统之前的45%限制。推进了对费米子量子系统中错误纠正要求的理解。

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一种利用受保护的六比特经典记录和经过验证的错误纠正直接制备纠缠非Clifford量子态的新颖方法，展示了35-37%的操作数减少，并具有三阶容错保证。

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二进制线性码通过可交换的克利福德可观测量解析纠缠分支，压缩魔态工厂的测量记录。结果：|CS⟩测量从8个减少到6个，|CCZ⟩从12个减少到7个（距离为四），实现26.6%的编译开销减少。

#量子纠错 #魔态 #容错

针对中性原子量子计算机的新颖全栈框架，通过协同设计的编译、架构和解码方案来解决量子比特损耗问题。相比基准架构，每轮损耗减少2倍，逻辑错误率改进80倍。

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PsiQuantum 在 IEEE QCE26 展示了量子资源估计技术、容错算法和开放访问开发工具，并提供了关于算法验证和架构感知编译的教程，用于优化量子电路的资源需求。

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研究人员展示了使用[[4,2,2]]错误检测码的Max-Cut容错QAOA。新颖的块间逻辑RZZ门能够实现多块量子电路，通过基于稳定子测量的后选择提高输出质量。

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